A80960JD

更新时间： 2024-02-11 03:33:15

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英特尔 - INTEL		微处理器
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59页	736K
描述
3.3 V EMBEDDED 32-BIT MICROPROCESSOR

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A80960JD 技术参数

生命周期：	Obsolete	零件包装代码：	PGA
包装说明：	PGA,	针数：	132
Reach Compliance Code：	unknown	风险等级：	5.84
地址总线宽度：	32	位大小：	32
边界扫描：	NO	最大时钟频率：	25 MHz
外部数据总线宽度：	32	格式：	FLOATING POINT
集成缓存：	NO	JESD-30 代码：	S-CPGA-P132
长度：	37.08 mm	低功率模式：	NO
端子数量：	132	最高工作温度：	85 °C
最低工作温度：		封装主体材料：	CERAMIC, METAL-SEALED COFIRED
封装代码：	PGA	封装形状：	SQUARE
封装形式：	GRID ARRAY	认证状态：	Not Qualified
座面最大高度：	4.57 mm	速度：	25 MHz
最大供电电压：	5.25 V	最小供电电压：	4.75 V
标称供电电压：	5 V	表面贴装：	NO
技术：	CMOS	温度等级：	OTHER
端子形式：	PIN/PEG	端子节距：	2.54 mm
端子位置：	PERPENDICULAR	宽度：	37.08 mm
uPs/uCs/外围集成电路类型：	MICROPROCESSOR, RISC	Base Number Matches：	1

A80960JD 数据手册

PRODUCT PREVIEW

80960JD

3.3 V EMBEDDED 32-BIT MICROPROCESSOR

• 3.3 V, 5 V Tolerant, Version of the 80960JD Processor

■ Pin/Code Compatible with all 80960Jx

■ 3.3 V Supply Voltage

— 5 V Tolerant Inputs

Processors

— TTL Compatible Outputs

■ High-Performance Embedded Architecture

— One Instruction/Clock Execution

— Core Clock Rate is 2x the Bus Clock

— Load/Store Programming Model

— Sixteen 32-Bit Global Registers

— Sixteen 32-Bit Local Registers (8 sets)

— Nine Addressing Modes

■ High Bandwidth Burst Bus

— 32-Bit Multiplexed Address/Data

— Programmable Memory Configuration

— Selectable 8-, 16-, 32-Bit Bus Widths

— Supports Unaligned Accesses

— Big or Little Endian Byte Ordering

— User/Supervisor Protection Model

■ High-Speed Interrupt Controller

— 31 Programmable Priorities

■ Two-Way Set Associative Instruction Cache

— 80960JD - 4 Kbyte

— Eight Maskable Pins plus NMI

— Up to 240 Vectors in Expanded Mode

— Programmable Cache Locking

Mechanism

■ Two On-Chip Timers

■ Direct Mapped Data Cache

— 80960JD - 2 Kbyte

— Independent 32-Bit Counting

— Clock Prescaling by 1, 2, 4 or 8

— lnternal Interrupt Sources

— Write Through Operation

■ Halt Mode for Low Power

■ On-Chip Stack Frame Cache

— Seven Register Sets Can Be Saved

— Automatic Allocation on Call/Return

— 0-7 Frames Reserved for High-Priority

Interrupts

■ IEEE 1149.1 (JTAG) Boundary Scan

Compatibility

■ Packages

— 132-Lead Pin Grid Array (PGA)

— 132-Lead Plastic Quad Flat Pack (PQFP)

■ On-Chip Data RAM

— 1 Kbyte Critical Variable Storage

— Single-Cycle Access

132

PIN 1

A80960JD

XXXXXXXXC0

i960

19xx

NG80960JD

XXXXXXXXC0S

19xx

Figure 1. 80960JD Microprocessor

November 1996

Order Number: 272971-001

12 3 4 5 6 7...59

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